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HIGH-SPEED 32/16K x 16
Features
SYNCHRONOUS
DUAL-PORT STATIC RAM
IDT709279/69S/L
◆
◆
◆
◆
◆
True Dual-Ported memory cells which allow simultaneous
access of the same memory location
High-speed clock to data access
– Commercial: 6.5/7.5/9/12/15ns (max.)
– Industrial: 12ns (max.)
Low-power operation
– IDT709279/69S
Active: 950mW (typ.)
Standby: 5mW (typ.)
– IDT709279/69L
Active: 950mW (typ.)
Standby: 1mW (typ.)
Flow-Through or Pipelined output mode on either port via
the FT /PIPE pin
Counter enable and reset features
◆
◆
◆
◆
◆
◆
Dual chip enables allow for depth expansion without
additional logic
Full synchronous operation on both ports
– 4ns setup to clock and 1ns hold on all control, data, and
address inputs
– Data input, address, and control registers
– Fast 6.5ns clock to data out in the Pipelined output mode
– Self-timed write allows fast cycle time
– 10ns cycle time, 100MHz operation in Pipelined output mode
Separate upper-byte and lower-byte controls for
multiplexed bus and bus matching compatibility
TTL- compatible, single 5V (±10%) power supply
Industrial temperature range (–40°C to +85°C) is
available for selected speeds
Available in a 100-pin Thin Quad Flatpack (TQFP) package
Functional Block Diagram
R/ W L
UB L
R/ W R
UB R
CE 0L
CE 1L
1
0
1
0
CE 0R
CE 1R
LB L
OE L
0/1
0/1
LB R
OE R
FT /PIPE L
0/1
1b 0b b a 1a 0a
0a 1a
a b 0b 1b
0/1
FT /PIPE R
I/O 8L -
I/O 15L
I/O
I/O
I/O 8R -I/O 15R
,
,
I/O 0L -I/O 7L
A 14L (1)
Control
Control
I/O 0R -I/O 7R
A 14R (1)
A 0L
CLK L
ADS L
CNTEN L
Counter/
Address
Reg.
MEMORY
ARRAY
Counter/
Address
Reg.
A 0R
CLK R
ADS R
CNTEN R
CNTRST L
CNTRST R
3243 drw 01
NOTE:
1. A 14 X is a NC for IDT709269.
JANUARY 2009
1
?2009 Integrated Device Technology, Inc.
DSC-3243/14
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